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對(duì)于400Gb以太網(wǎng)解決方案和雙200Gb s InfiniBand等高端網(wǎng)絡(luò),PCIe 5.0架構(gòu)以全雙工方式運(yùn)行,可提供高達(dá)128GB s的帶寬。較高的帶寬將為加速器和GPU,以及所有需要提高帶寬的應(yīng)用提供支持。
近日已通過(guò)PCI-SIG合規(guī)測(cè)試,意味著未來(lái)設(shè)計(jì)師能將超低功率的PCIe3 PHY IP,整合至以28納米制程技術(shù)為目標(biāo)的裝置。其精簡(jiǎn)的面積減少了SoC芯片大小并降低成本。
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